※ 本文轉寄自 ptt.cc 更新時間: 2022-09-12 23:22:02
看板 Tech_Job
作者 標題 [討論] 入行門檻最低的是驗證嗎?
時間 Mon Sep 12 11:43:54 2022
數位驗證在科技業有越來越重要的趨勢
使用的工具、程式語言不外乎是SystemVerilog, UVM, Formal等等
還有一點自動化的工具，例如Perl, Tcl
不過這些東西大多要就業才會碰到，學校、資策會或自強都很少學
以新鮮人來說，面試下來即使一線dv(螃蟹、發哥)考的東西也不難
頂多簡單的Verilog或C++ class
以新鮮人來說，面試下來即使一線dv(螃蟹、發哥)考的東西也不難
頂多簡單的Verilog或C++ class
連資料結構都沒有，軟韌考的還比較難
數位驗證是不是科技業最好入門的職位? 即使非電資都有機會
發展性、出路甚至不輸給FW
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※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 150.117.226.58 (臺灣)
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※ 編輯: PPTplayer (150.117.226.58 臺灣), 09/12/2022 11:47:19
反而當時都沒有投FW，是聽朋友跟心得文發現FW好像考比較難
DV反而少，但DV有加考Verilog Coding跟硬體觀念(不難頂多到CDC)
※ 編輯: PPTplayer (150.117.226.58 臺灣), 09/12/2022 12:06:58
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→ : 考的不難，但門檻是學歷1F 09/12 11:48
推 : 門檻最低的應該是電子菁英課程2F 09/12 11:51
推 : DV很爽欸3F 09/12 11:59
推 : 能做dv的都能作dd吧4F 09/12 12:00
確實 當時offer選都是DE跟DV一起挑還有CAD反而當時都沒有投FW，是聽朋友跟心得文發現FW好像考比較難
推 : 軟韌考比較難喔？5F 09/12 12:00
就Coding的項目來說是，我同實驗室的有考很多資料結構DV反而少，但DV有加考Verilog Coding跟硬體觀念(不難頂多到CDC)
※ 編輯: PPTplayer (150.117.226.58 臺灣), 09/12/2022 12:06:58
推 : 軟韌基本上都當資工在考啊 或是夾雜domain know在6F 09/12 12:07
→ : 考卷或是直接問
→ : 聽起來dv真的很好入門...朋友面螃蟹dv也是簡單考了
→ : 個verilog 狀態機 學歷有到
→ : 就上了...而且發展看dv比軟韌 SA那些好很多... 原P
→ : O這樣說好像不無道理
→ : 考卷或是直接問
→ : 聽起來dv真的很好入門...朋友面螃蟹dv也是簡單考了
→ : 個verilog 狀態機 學歷有到
→ : 就上了...而且發展看dv比軟韌 SA那些好很多... 原P
→ : O這樣說好像不無道理
→ : 要先有DV驗過,最後才有實體ic給FW發揮啊12F 09/12 12:25
→ : DV一直都有需求
→ : DV一直都有需求
→ : 非電資有機會？14F 09/12 12:31
→ : 哪家找非電資的去做啦
→ : 哪家找非電資的去做啦
→ : 入行門檻跟技術無關，跟公司有關。16F 09/12 12:34
推 : 你完全搞錯了.......17F 09/12 12:35
→ : 我假設你是真不懂不是故意要酸
→ : 一套EDA賣你DCR要多貴
→ : 我假設你是真不懂不是故意要酸
→ : 一套EDA賣你DCR要多貴
推 : 面試難度不一定等於錄取人的難度20F 09/12 12:37
推 : DV在各大公司就是RD無庸置疑21F 09/12 12:38
推 : X肉某team 連DV都要省 說什麼AE自己驗才真的懂IC22F 09/12 12:46
→ : 講得好像類比驗證都廢物很閒一樣
→ : 講得好像類比驗證都廢物很閒一樣
推 : 感覺很好面是因為不能問深入啊，台灣沒有專門這個24F 09/12 12:50
→ : 的實驗室，除非出來有碰過，不然問UVM/VMM，問asser
→ : tion甚至問Formal大概都一頭霧水，只好退而求其次
→ : 問Verilog問OOP
推 : 跟DE討論驗證的東西或是Formal那種數學證明，除非
→ : 很資深很強的，不然大概都一臉問號吧（攤手
→ : 的實驗室，除非出來有碰過，不然問UVM/VMM，問asser
→ : tion甚至問Formal大概都一頭霧水，只好退而求其次
→ : 問Verilog問OOP
推 : 跟DE討論驗證的東西或是Formal那種數學證明，除非
→ : 很資深很強的，不然大概都一臉問號吧（攤手
推 : 好的DV要懂設計也要懂資工 感覺很好進是因為缺工30F 09/12 12:55
推 : DV好進是因為缺工，沒實力一下就被RD電到釘在牆上31F 09/12 13:12
推 : 趕快先找進來先學先鍛鍊 後面都好說QQ32F 09/12 13:13
→ : it?33F 09/12 14:31
→ : support team 才是沒門檻的吧34F 09/12 15:59
推 : 有些台廠DV抓到bug被當作應該的 沒抓到就背鍋35F 09/12 16:13
→ : Tier 1台廠的DV也是很挑學歷，除非你很有經驗36F 09/12 17:52
→ : 好的DV可以跟RD討論fsdb waveform來看design，甚至
→ : 可以根據spec.跟你討論RTL
→ : 爛的DV就是regression跑一跑只會跟你說卡在他的c co
→ : de哪個地方，其他RD自己想辦法
→ : 好的DV可以跟RD討論fsdb waveform來看design，甚至
→ : 可以根據spec.跟你討論RTL
→ : 爛的DV就是regression跑一跑只會跟你說卡在他的c co
→ : de哪個地方，其他RD自己想辦法
→ : 有看過只會用for loop跟task做驗證的41F 09/12 18:11
→ : 這樣能抓到bug也是很神
→ : 這樣能抓到bug也是很神
→ : 這都只是工具 重點是對spec的理解打到corner case43F 09/12 19:30
推 : 現在都是先抓四大電資的進來練功吧 畢竟DV很缺 學校44F 09/12 19:31
→ : 又沒教
→ : 又沒教
推 : 那個…設計驗證，不是數位驗證46F 09/12 19:37
推 : 哪間的驗證可以只負責丟regression就好跪求內推47F 09/12 19:39
推 : 當然還要跑一些coverage的東西呀，同一間我遇過好48F 09/12 19:47
→ : 的跟爛的
→ : 的跟爛的
→ : 反正都是corner case出錯，用patched過的driver即可50F 09/12 20:51
推 : 二樓太狠了51F 09/12 22:43
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